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Fターム[4M104HH07]の内容

半導体の電極 (138,591) | 目的 (7,416) | チャンネリング防止 (4)

Fターム[4M104HH07]に分類される特許

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【課題】信頼性の高い半導体装置を製造する。
【解決手段】半導体装置の製造方法は、半導体基板50上に絶縁膜を形成する工程と、絶縁膜上に、ゲート電極20およびハードマスク34を順に積層してなる積層体10を形成する工程と、積層体10をマスクとして、半導体基板50にイオン注入を行う工程と、積層体10の側面上に保護膜44を形成する工程と、エッチングによりハードマスク34を除去する工程と、エッチングにより保護膜44を除去する工程と、を備える。 (もっと読む)


【課題】動作マージンの向上に対して有利な半導体装置およびその製造方法を提供する。
【解決手段】実施形態によれば、半導体装置は、半導体基板上に、互いのゲート電極が接続されて配置される第1トランジスタ(P2)と、前記第1トランジスタと異なる導電型を有する第2トランジスタ(N4)とを具備し、前記第1トランジスタのゲート電極は、第1不純物と前記第1不純物の拡散を抑制する第2不純物とを含有し、前記第1不純物の濃度ピーク(PE1)は、前記第2不純物の濃度ピーク(PE2)よりも浅い位置に形成されている。 (もっと読む)


【課題】 イオン注入時のチャネリングを防止することが可能な半導体装置の製造方法を提供する。
【解決手段】 キャパシタを有する半導体装置の製造工程において、キャパシタの誘電膜となる絶縁膜とゲート電極上のチャネリング防止膜を同時に形成する。製造工程の簡略化および熱工程の削減が可能となる。 (もっと読む)


【課題】ノーマリーオフ動作を実現可能な半導体装置を提供する。
【解決手段】本発明の半導体装置は、アンドープのAlGa1−XN(0≦X≦1)を含む第1の半導体層3と、第1の半導体層3上に設けられ、アンドープもしくはn型のAlGa1−YN(0≦Y≦1、X<Y)を含み、第1の半導体層3よりもバンドギャップが大きい第2の半導体層4と、第2の半導体層4上におけるソース電極5とドレイン電極6との間に設けられたゲート電極7とを備え、ゲート電極7下の第2の半導体層4中であって第1の半導体層3に達しない深さの部分に、第2の半導体層4中で負電荷を帯びる原子が添加されている。 (もっと読む)


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