【課題】スピーカにスイッチを直列接続し、ＰＷＭ回路のパルス出力によってスイッチに流す電流を制御するスピーカ駆動システムを提供する。
【解決手段】スピーカのボイスコイルの一方の駆動端子にスイッチ素子の一方の電流端子を接続し、スイッチ素子の制御端子にマイクロコンピュータを接続し、ボイスコイルの他方の駆動端子とスイッチ素子の他方の電流端子との内の一方を回路のグランド端子に、他方を電源端子に接続する。マイクロコンピュータは、ＰＷＭ回路によってパルス信号のデューティ比を制御し、ＰＷＭ回路から出力されるパルス信号のデューティ比に応じてスイッチ素子に電流を流すスイッチ制御信号を出力回路から前記制御端子に出力するデータ処理ユニットを有する。データ処理ユニットは無音時のパルス信号のデューティ比を第１値とし、発生させる音に応じて、第１値を中心にパルス信号のデューティ比を変化させるようにＰＷＭ回路を制御する。 （もっと読む）

【課題】出力信号の立ち下がりのスロープ特性をその場で可変できる機能を有するドライバ回路を提供する。
【解決手段】入力信号ＴＸＤを受け、駆動出力ノードＮ１、Ｎ２から駆動信号Ｖ１、Ｖ２を出力する駆動制御回路１１、１２と、駆動信号Ｖ１、Ｖ２を受けて駆動されるＭＯＳトランジスタＭ７、Ｍ８を有し、差動出力信号Ｖｄｉｆｆを外部負荷に送出する出力バッファ回路１３と、駆動制御回路１１、１２に付加され、入力信号ＴＸＤを受け、該入力信号の論理レベルが所定の方向に変化した時にＭＯＳトランジスタＭ７、Ｍ８がオン状態からオフ状態に変化する動作の開始時間を短縮する動作開始加速回路１４、１５と、動作開始加速回路１４、１５に付加され、選択信号Ｖｓｅｌに応じてＭＯＳトランジスタＭ７、Ｍ８がオン状態からオフ状態に変化する動作の終了時間を可変する動作終了可変回路１６、１７と、を具備する。 （もっと読む）

【課題】許容電力と挿入損出との特性を両立させるとともに、アンテナスイッチ回路の小型化を可能とし、且つスイッチング状態の更なる安定化を図ることができるようにする。
【解決手段】本発明によるアンテナスイッチ回路は、送信ポートとアンテナポートとの間に直列に接続された直列トランジスタ回路と、前記送信ポートと前記アンテナポートとの間に並列に接続された並列トランジスタ回路と、前記送信ポートと前記並列トランジスタ回路との間に設けられ、インピーダンス変換を行うことによって、前記送信ポートから入力された送信信号の電圧振幅を所定の変換比率で縮小するインピーダンス変換回路とを備え、前記インピーダンス変換回路は、前記並列トランジスタ回路に出力される端子間電圧が当該並列トランジスタ回路の閾値以下となるように前記所定の変換比率が設定されていることを特徴とする。 （もっと読む）

【課題】素子特性の変動による遮断特性の悪化を防止することのできる高周波スイッチ回路を提供する。
【解決手段】入出力端子Ｐｏｒｔ１、Ｐｏｒｔ２を有する高周波スイッチ回路１１は、一端がＰｏｒｔ２に接続されたｎ型ＭＯＳＦＥＴ１の他端に、直列接続された可変容量キャパシタ２とインダクタ３とが、直列に接続され、インダクタ３の他端がＰｏｒｔ１に接続されている。 （もっと読む）

【課題】信号の電力漏洩を抑制することができる切替回路を提供することを課題とする。
【解決手段】第１の端子（Ｐ１）と、第２の端子（Ｔｘ）と、第３の端子（Ｒｘ）と、前記第１の端子及び前記第２の端子間に直列に接続される第１のトランジスタ（３０１）と、前記第１の端子及び前記第３の端子間において前記第１の端子側から順に接続される第１のインピーダンス変換素子（３１２）、第２のトランジスタ（３０２）、第３のトランジスタ（３０３）及び第２のインピーダンス変換素子（３１３）とを有し、前記第２のトランジスタは、前記第３のトランジスタ及び前記第１のインピーダンス変換素子の相互接続点と基準電位ノードとの間に接続され、前記第３のトランジスタは、前記第１のインピーダンス変換素子及び第２のインピーダンス変換素子間に直列に接続される切替回路が提供される。 （もっと読む）

【課題】シリーズＦＥＴおよびシャントＦＥＴとして４端子ＮＭＯＳＦＥＴを用いるＳＰＳＴスイッチ回路では、シリーズＦＥＴがオン状態で、シャントＦＥＴがオフ状態のときに、ＳＰＳＴスイッチ回路はオン状態になる。ＦＥＴのバックゲートには寄生ダイオードが存在し、入力交流信号電圧が所定の閾値を超えると、寄生ダイオードがオン状態になる。その結果、ＳＰＳＴスイッチ回路はスイッチ・デバイスとしての線形動作を維持できなくなり、挿入損失特性やゆがみ特性が悪化する場合がある。
【解決手段】ＦＥＴのバックゲートに、バイアス電圧を印加するためのバイアス電源を設ける。このバイアス電源として、ＤＣ−ＤＣ変換回路を用いることで、ＳＰＳＴスイッチ回路をシリコン半導体チップ化することが容易になる。 （もっと読む）

【課題】 線形サンプリングスイッチ
【手段】 サンプリング回路はｐチャネル及びｎチャネル電界効果トランジスタ（ＦＥＴ）で構成される。ｐチャネルＦＥＴ（４２）のソースノードはｎチャネルＦＥＴ（４０）のドレインノードに結合され、ｐチャネルＦＥＴ（４２）のドレインノードはｎチャネルＦＥＴ（４０）のソースノードに結合される。サンプリングクロックは各ＦＥＴのゲートノードに結合される。線形サンプリング回路の第１の側はアナログまたはＲＦ信号源に接続され、そして線形サンプリング回路の向う側は保持キャパシタ（４４）に接続される。ｎチャネルＦＥＴはｎチャネル幅を有する。ｐチャネルＦＥＴはｐチャネル幅を有する。結果としてスイッチのオン抵抗の線形性を増加させるために、ｐチャネル幅はｎチャネル幅よりも大きい。 （もっと読む）

【課題】切替え時のノイズを低減したアナログスイッチ回路を提供する。
【解決手段】入力信号をｎ個（ｎは、１以上）の出力信号としてそれぞれ出力するｎ個のスイッチ素子と、前記ｎ個のスイッチ素子を制御するスイッチ制御回路と、前記入力信号の負荷となるインピーダンス素子と、前記インピーダンス素子を制御するインピーダンス制御回路と、を備え、前記スイッチ制御回路は、前記ｎ個のスイッチ素子のすべてがオフ、またはいずれか１つがオンとなるように制御し、前記インピーダンス制御回路は、前記ｎ個のスイッチ素子のいずれか１つがオンのときは、前記インピーダンス素子を最大のインピーダンスに制御し、前記ｎ個のスイッチ素子がすべてオフのときは、前記インピーダンス素子を前記最大のインピーダンスよりも小さい第１のインピーダンスに制御する、ことを特徴とするアナログスイッチ回路が提供される。 （もっと読む）

【課題】入力信号電圧が変化する場合にも、オン抵抗の変動によって入力信号波形に生ずる歪みを低減し、入力連続信号の広い周波数帯域に渡ってオン抵抗を一定に保つことができるアナログスイッチ回路を提供することを課題とする。
【解決手段】ソースが第１のスイッチ端子に接続され、ドレインが第２のスイッチ端子に接続される第１の電界効果トランジスタ（ＭＮ）と、電荷を充電するための第１の容量（ＣＰ）と、電荷を充電するための第２の容量（ＣＡ）と、直流電圧ノードと基準電位ノードとの間に第１の容量を接続するための第１のスイッチ回路（Ｓ１ＨＰ，Ｓ１ＬＰ）と、第１の容量及び第２の容量を並列に接続するための第２のスイッチ回路（Ｓ１ＨＳ，Ｓ１ＬＳ）と、第１の電界効果トランジスタのゲートとソースとの間に第２の容量を接続するための第３のスイッチ回路（Ｓ２ＨＳ，Ｓ２ＬＳ）とを有するアナログスイッチ回路が提供される。 （もっと読む）

【課題】トランジスタと容量によって情報を記憶し、リフレッシュを必要としないＲＦＩＤタグを提供する。
【解決手段】第１のトランジスタ、第２のトランジスタ、第３のトランジスタ、容量およびバッファを有するＲＦＩＤタグであり、第２のトランジスタのソースおよびドレインの一方は入力端子に電気的に接続され、ソースおよびドレインの他方は、第１のトランジスタのソースおよびドレインの一方かつ第３のトランジスタのソースおよびドレインの一方に電気的に接続され、第１のトランジスタのソースおよびドレインの他方は容量の一方の電極かつバッファの入力に電気的に接続され、容量の他方の電極は基準電圧端子に電気的に接続され、バッファの出力は出力端子および第３のトランジスタのソースおよびドレインの他方に電気的に接続される。 （もっと読む）

【課題】出力バッファ回路の出力ノイズを低減し、かつ、応答速度を速くする。
【解決手段】出力電圧ＶＯＵＴが接地電圧ＶＳＳからＮＯＲの反転電圧ＶＬに変化する場合、及び、電源電圧ＶＤＤからＮＡＮＤの反転電圧ＶＨに変化する場合、２個のＭＯＳトランジスタの両方が出力電圧ＶＯＵＴを制御するので、出力電圧ＶＯＵＴのスルーレートが急峻になる。よって、出力バッファ回路の応答速度が速くなる。また、出力電圧ＶＯＵＴが電圧（ＶＤＤ／２）付近で変化する上記以外の場合、１個のＭＯＳトランジスタだけが出力電圧ＶＯＵＴを制御するので、出力電圧ＶＯＵＴのスルーレートが緩やかになる。よって、出力バッファ回路の応答速度が遅くなるので、出力ノイズが低減する。 （もっと読む）

【課題】素子数が少なくでき、且つグランドバウンスの影響が抑えられるようにしたＢＴＬ回路を提供する。
【解決手段】トランジスタＭＰ１，ＭＰ２と、該各トランジスタＭＰ１，ＭＰ２に直列接続されたトランジスタＭＮ１，ＭＮ２とからなり、トランジスタＭＰ１とＭＮ１の共通接続点を出力端子ＯＵＴＰとし、トランジスタＭＰ２とＭＮ２の共通接続点を出力端子ＯＵＴＮとするＢＴＬ回路である。入力端子ＶＩＮの入力信号とトランジスタＭＰ１のゲート電位を反転遅延させた信号とトランジスタＭＮ２のゲート電位の信号とを入力して、出力を、トランジスタＭＮ１のゲートにそのままの位相で帰還させ、トランジスタＭＰ２のゲートに反転して帰還させるノア回路ＮＯＲ１を有する。また、入力端子ＶＩＮの入力信号とトランジスタＭＮ１のゲート電位を反転遅延させた信号とトランジスタＭＰ２のゲート電位の信号とを入力して、出力を、トランジスタＭＰ１のゲートにそのままの位相で帰還させ、トランジスタＭＮ２に反転して帰還させるナンド回路ＮＡＮＤ１を有する。 （もっと読む）

【課題】補償回路とプリドライバを組み込んでおり、プロセス変動に対して補償されるスルーレートを有する出力バッファを提供する。
【解決手段】補償回路３７０は、演算増幅器２５０と、増幅器の出力に結合されたゲートを有する第２のＮＦＥＴ２４０、第３のＮＦＥＴ３７１、及び実行抵抗３８１から構成される。出力バッファ３００は、ＩＣチップのコア１５０がプリドライバ３１０に制御信号をアサートする。これに応答して、プリドライバ３１０は、第１のＮＦＥＴ３２０にバッファリングされた制御信号をアサートし、第１のＮＦＥＴ３２０をオンにし、ＶＳＳレベルの出力信号をパット２３０にアサートする。 （もっと読む）

【課題】改良された歪み特性，低減された消費電力，低減された回路サイズおよび向上されたサンプリングレートの少なくとも１つを可能にする電流モード回路の提供を図る。
【解決手段】電流信号Ｉ_INをサンプリングする電流モード回路４０であって、前記電流信号が印加される第１ノード（Ｉ_IN）と、それぞれ経路を通って前記第１ノードに導電的に接続され得るＸ個の第２ノードＡ〜Ｄと、前記第１ノードと前記第２ノード間の接続を、前記電流信号を構成する電荷の異なるパケットが、時間の経過により異なる前記経路を通ってステアされるように制御するステアリング手段４２と、を有し、前記Ｘは、３以上の整数であり、前記ステアリング手段は、Ｘ個の時間インターリーブされた湾曲の制御信号を生成する制御信号生成手段と、前記経路を通って分配され、前記Ｘ個の湾曲の制御信号に従って制御を実行するスイッチング手段と、を有するように構成する。 （もっと読む）

スイッチ再構成タイミング要件の異なる複数のデータフォーマットを同時にサポートするクロスポイント・セレクタスイッチは、演算スイッチ・データに応じて、その出力を選択的にその入力のそれぞれからデータを受け取るように接続する構成可能なスイッチ部と、このスイッチ部に演算スイッチ・データを供給するように動作可能に接続されている構成部とを備えている。構成部は、スイッチ部の複数の異なる構成をサポートするスイッチ構成データを記憶し、また、構成部は、スイッチ部の異なる構成とそれぞれ関連付けられた異なる演算更新コマンドを受け取って、異なる演算更新コマンドのどれを受け取ったのかに基づき、記憶しているスイッチ構成データで演算スイッチ・データを更新することでスイッチ部を再構成するように動作する。 （もっと読む）

【課題】回路面積が小さく、製造バラツキによる出力特性の劣化を修正できる出力回路を提供することにある。
【解決手段】本発明による出力回路は、差動入力信号ＤＩに応じた差動出力信号ＢＰ、ＢＮを出力端子対３１、３２から出力するメインバッファ回路１と、制御信号ＣＳに応じて出力端子対３１、３２のインピーダンスを調整するトリミング回路２とを具備する。トリミング回路２は、第１電源ＶＤＤと出力端子対３１、３２との間に、メインバッファ回路１内の第１トランジスタ対ＭＰ１、ＭＰ２及び第１抵抗対Ｒ１、Ｒ２に対して並列に接続された少なくとも１つの第２トランジスタ対ＭＰ１１、ＭＰ２１を備える。 （もっと読む）

【課題】バースト動作区間で一定区間ごとにパルスを発生させるために用いられるクロックシフターの数を減少させることによって、ＬＰＤＤＲ２で回路の具現が容易で且つ電流消耗を節減できるようにするバーストモード制御回路を提供する。
【解決手段】バーストモード動作区間の間にイネーブルされるバースト区間信号を生成するバースト区間信号生成部と、リードコマンド及びライトコマンドに応答してバースト区間信号のイネーブル区間の間に所定周期ごとに生成されるパルスを含むバーストパルスを生成するバーストパルス生成部と、バーストパルス及びクロック信号を受信してバーストモード動作区間の間にデータ入出力を制御するカラムアクセス信号を生成するカラムアクセス信号生成部と、を含む構成とした。 （もっと読む）

【課題】従来のスイッチ素子の故障検知回路では、負荷が動作しない程度の低電圧電源を使用するため、負荷の動作電圧を厳密に意識し、また、使用環境条件が変化した場合でも特性等がばらつかないという条件も必要となり、使用可能な負荷が限定されるという問題があった。
【解決手段】負荷を駆動するための負荷駆動電源と、負荷駆動電源の電圧が印加されることで動作する負荷と、負荷駆動電源と負荷間の正極側に接続されたスイッチ素子と、負荷駆動電源とスイッチ素子の状態に対応した表示をするセンサとを備えたスイッチ素子の故障検知回路において、負荷駆動電源と並列に逆極性で故障検知用電源を接続し、故障検知用電源で逆電流を流してスイッチ素子の故障検知を行う。 （もっと読む）

【課題】小型で低損失なスイッチ回路及び受信装置を提供することを課題とする。
【解決手段】１個以上の入力ポート（Ｐ１〜Ｐｎ）と、前記１個以上の入力ポートのそれぞれに接続される１個以上の単極単投スイッチ（６０１ａ〜６０１ｎ）と、前記１個以上の単極単投スイッチを介して前記１個以上の入力ポートに接続される１個の出力ポート（Ｐｎ＋１）と、前記出力ポート及び基準電位ノード間に接続され、第１の制御電圧では前記出力ポート及び前記基準電位ノード間を開放状態にし、第２の制御電圧では前記出力ポート及び前記基準電位ノード間を第１の抵抗値での接続状態にするトランジスタ（６０２）とを有することを特徴とするスイッチ回路が提供される。 （もっと読む）

【課題】製造プロセスのマージンを削ることなく、オフセットの補正が可能なラッチ型コンパレータ、及びこれを用いた、オフセットの補正が可能な多値論理の復調回路を提供する
【解決手段】本発明によるラッチ型コンパレータは、クロスカップルされた２つのＣＭＯＳインバータからなるフリップフロップを含み、フリップフロップの４個のトランジスタの各々のソースと電源／接地間には伝達トランジスタを介して抵抗と設定電流可変の定電流源が接続され、フリップフロップの差動出力は各々伝達トランジスタを介して差動入力に接続され、全ての伝達トランジスタのゲートは、差動クロック入力のいずれかに接続されていることを特徴とする。 （もっと読む）